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| A reconfigurable computing architecture for 5G communication 期刊论文
Journal of Central South University, 2019, 期号: 0, 页码: 0
作者: GUO Yang ; LIU Zi-Jun; YANG Lei; LI Huan; WANG Dong-Lin
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5g Instruction Set Register File Code Compression Throughput Power Consumption. |
| A High-Efficiency FPGA-Based Accelerator for Binarized Neural Network 期刊论文
Journal of Circuits, Systems, and Computers, 2019, 卷号: 28, 期号: 1, 页码: 1
作者: Guo Peng; Ma Hong; Ruizhi Chen; Donglin Wang
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Cnn Bnn Fpga Accelerator |
| Accelerate Convolutional Neural Network with a customized VLIW DSP 会议论文
, 北京, 2018-10
作者: Guo Peng; Ma Hong; Guo Ruoshan; Liu Zhuang; Li Pin; Wang Donglin
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| Parallel Polar Encoding in 5G Communication 会议论文
, 巴西纳塔尔, 2018-6
作者: Yang Guo; Shaolin Xie; Zijun Liu; Lei Yang; Donglin Wang
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| FBNA: A Fully Binarized Neural Network Accelerator 会议论文
, 爱尔兰都柏林, 2018-8
作者: Guo Peng; Hong Ma; Ruizhi Chen; Pin Li; Shaolin Xie; Donglin Wang
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| Advanced Extensible Crossbar Protocol for Connecting Multi-Cores and Shared-Memory on Chip 会议论文
, Beijing,China, 2018,6.15-17
作者: Hongyu,Meng; Donglin,Wang; Zijun,Liu; Yang,Guo
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Interconnect Crossbar Multi-cores Shared-memory |
| A Self-Indexed Register File for Efficient Arithmetical Computing Hardware 会议论文
, UK, 2017-10
作者: Lei Yang; Shaolin Xie; Zijun Liu; Xueliang Du; DongLin Wang
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Register File Arithmetical Computing Energy Efficient |
| 无权访问的条目 会议论文
作者: Meng Liu; Zhiwei Zhang; Wenqin Sun; Donglin Wang
Adobe PDF(157Kb) | 收藏 | 浏览/下载：37/1 | 提交时间：2019/01/15 |
| 无权访问的条目 会议论文
作者: Meng Liu; Zhiwei Zhang; Wenqin Sun; Donglin Wang
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