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作者:王东琳
第一作者
作者:杨磊
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A reconfigurable computing architecture for 5G communication
期刊论文
Journal of Central South University, 2019, 期号: 0, 页码: 0
作者:
GUO Yang
;
LIU Zi-Jun
;
YANG Lei
;
LI Huan
;
WANG Dong-Lin
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提交时间:2019/07/11
5g
Instruction Set
Register File
Code Compression
Throughput
Power Consumption.
A Bypass-Based Low Latency Network-on-Chip Router
期刊论文
IEICE Electronics Express, 2019, 卷号: 16, 期号: 4, 页码: 1
作者:
Guo Peng
;
Qingbin Liu
;
Ruizhi Chen
;
Lei Yang
;
Donglin Wang
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提交时间:2019/06/17
Network-on-chip
Router
Bypass
Low Latency
Parallel Polar Encoding in 5G Communication
会议论文
, 巴西纳塔尔, 2018-6
作者:
Yang Guo
;
Shaolin Xie
;
Zijun Liu
;
Lei Yang
;
Donglin Wang
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提交时间:2019/05/10
A high-throughput network on-chip in full-mesh architecture
期刊论文
IEICE ELEX, 2018, 卷号: 15, 期号: 17, 页码: 1-12
作者:
Hongyu,Meng
;
Lei,Yang
;
Zijun.Liu
;
Donglin.Wang
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提交时间:2019/05/06
Network On-chip
Full-mesh
High Connectivity
Multi-core
A bypass-based low latency network-on-chip router
期刊论文
IEICE ELECTRONICS EXPRESS, 2019, 卷号: 16, 期号: 4, 页码: 12
作者:
Guo, Peng
;
Liu, Qingbin
;
Chen, Ruizhi
;
Yang, Lei
;
Wang, Donglin
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浏览/下载:286/0
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提交时间:2019/04/23
network-on-chip
router
bypass
low latency
A Self-Indexed Register File for Efficient Arithmetical Computing Hardware
会议论文
, UK, 2017-10
作者:
Lei Yang
;
Shaolin Xie
;
Zijun Liu
;
Xueliang Du
;
DongLin Wang
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提交时间:2018/05/07
Register File
Arithmetical Computing
Energy Efficient
A reconfigurable ASIC-like image polyphase interpolation implementation method
会议论文
, ShenZhen, 2017-7
作者:
Lei Yang
;
Ruoshan Guo
;
Shaolin Xie
;
Donglin Wang
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提交时间:2018/05/07
Image Interpolation
Acceleration
Reconfigurable Implementation
An approach to build cycle accurate full system VLIW simulation platform
期刊论文
SIMULATION MODELLING PRACTICE AND THEORY, 2016, 卷号: 67, 期号: 2016, 页码: 14-28
作者:
Yang, Lei
;
Wang, Lei
;
Zhang, Xing
;
Wang, DongLin
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提交时间:2016/12/26
Vliw Simulation
Cycle Accurate
Heterogeneous Computing