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国家专用集成电路设计工程技术研究中心
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专题:国家专用集成电路设计工程技术研究中心
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作者:刘子君
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Parallel LDPC Decoder Based on Low-Complexity Corrected Min Sum Algorithm
会议论文
, Suzhou, China, 2022-4-23
作者:
Sun, Yisong
;
Li, Huan
;
Zhang, Xinyu
;
Guo, Chen
;
Liu, Zijun
;
Wang, Donglin
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浏览/下载:251/63
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提交时间:2022/06/14
5G
LDPC decoder
LCC-MS
UCP
A reconfigurable computing architecture for 5G communication
期刊论文
Journal of Central South University, 2019, 期号: 0, 页码: 0
作者:
GUO Yang
;
LIU Zi-Jun
;
YANG Lei
;
LI Huan
;
WANG Dong-Lin
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浏览/下载:435/130
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提交时间:2019/07/11
5g
Instruction Set
Register File
Code Compression
Throughput
Power Consumption.
A Distributed Register File Architecture Based on Dynamic Scheduling for VLIW Machine
会议论文
, 北京, 2018-6
作者:
Yang Guo
;
Donglin Wang
;
Zijun Liu
;
Hongyu Meng
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浏览/下载:300/122
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提交时间:2019/05/10
Parallel Polar Encoding in 5G Communication
会议论文
, 巴西纳塔尔, 2018-6
作者:
Yang Guo
;
Shaolin Xie
;
Zijun Liu
;
Lei Yang
;
Donglin Wang
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浏览/下载:330/113
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提交时间:2019/05/10
Traffic-Aware and Memory-Aware Task Scheduling on Multi-Core Chips
会议论文
, Beijing,China, 2018,11.23-25
作者:
Hongyu,Meng
;
Yang,Guo
;
Zijun.Liu
;
Donglin.Wang
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浏览/下载:292/96
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提交时间:2019/05/06
Task Scheduling
Multi-core
Shared Memory
Traffic-aware
Memory-aware
Advanced Extensible Crossbar Protocol for Connecting Multi-Cores and Shared-Memory on Chip
会议论文
, Beijing,China, 2018,6.15-17
作者:
Hongyu,Meng
;
Donglin,Wang
;
Zijun,Liu
;
Yang,Guo
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浏览/下载:302/103
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提交时间:2019/05/06
Interconnect
Crossbar
Multi-cores
Shared-memory
Progress in a novel architecture for high performance processing
期刊论文
JAPANESE JOURNAL OF APPLIED PHYSICS, 2018, 卷号: 57, 期号: 4
作者:
Zhang, Zhiwei
;
Liu, Meng
;
Liu, Zijun
;
Du, Xueliang
;
Xie, Shaolin
;
Ma, Hong
;
Ding, Guangxin
;
Ren, Weili
;
Zhou, Fabiao
;
Sun, Wenqin
;
Wang, Huijuan
;
Wang, Donglin
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提交时间:2018/10/10
A reconfigurable high-performance multiplier based on multi-granularity design and parallel acceleration
会议论文
, 中国科技会堂, 2017-11
作者:
Feng Jing
;
Zijun Liu
;
Xiaojun Ma
;
Guo Yang
;
Guo Peng
;
Donglin Wang
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浏览/下载:499/197
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提交时间:2018/05/31
Compression
High Speed
Multi-granularity
Parallel
Power Efficient
Reuse
Reconfigurable
A Self-Indexed Register File for Efficient Arithmetical Computing Hardware
会议论文
, UK, 2017-10
作者:
Lei Yang
;
Shaolin Xie
;
Zijun Liu
;
Xueliang Du
;
DongLin Wang
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浏览/下载:301/70
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提交时间:2018/05/07
Register File
Arithmetical Computing
Energy Efficient
MaPU: A Novel Mathematical Computing Architecture
会议论文
http://hpca22.site.ac.upc.edu, Barcelona, Spain, March 12-16 2016
作者:
Donglin Wang
;
Shaolin Xie
;
Zhiwei Zhang
;
Xueliang Du
;
Lei Wang
;
Zijun Liu
;
shaolin.xie@ia.ac.cn
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提交时间:2016/04/07
Computer Architecture
Vlsi
High Performance Computing